基于FPGA的SoftSerdes设计与实现

chengyabcd 18 0 PDF 2020-10-30 21:10:26

串行I/O技术所需的时钟数据恢复(CDR)技术和CDR技术所需的模拟锁相环(PLL)通常会降低电路性能。为此,文中给出了一种基于FPGA的新型全数字串/并转换设计方案。