基于FPGA的嵌入式PLC微处理器设计

该处理器采用了TOP—DOWN的层次网络模块化设计方法,用VHDL描述了嵌入式PLC的CPU的主要逻辑功能,考虑到嵌入式CPU结构的复杂性和设计的可扩展性,在顶层设计中采用了原理图的方法,通过VHDL对每个单元模块进行了仿真和综合,然后将综合生成的各个模块连接起来,组成了一个整体