实验内容: 1)设计程序查找一维数组的最大(小)值、中值和均值; 2)实现具有简单人机界面的加、减、乘、除、开方和幂运算计算器; 3)分别采用定时中断和定时器,设计秒表和倒计时表,并能显示日历。
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综合布线实验主要是在智宇大楼进行。
根据频率的定义和频率测量的基本原理,测定信号的频率必须有一个脉宽为1 秒的输入信号脉冲计数允许的信号;1秒计数结束后,计数值被锁入锁存器,计数器 清零,为下一测频周期做好准备。测频控制信号可以由一个独
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EDA软件的熟悉与使用,三八译码器设计,简单组合逻辑设计,简单分频时序逻辑电路的设计,利用条件语句实现计数分频时序电路,在Verilog HDL中使用函数和任务,always块实现较复杂的组合逻辑电路
郑州大学资深教师的《数据结构》讲义,希望对大家有帮助