Verilog是一种用于描述、设计电子系统(特别是数字电路)的硬件描述语言,主要用于在集成电路设计,特别是超大规模集成电路的计算机辅助设计。Verilog是电气电子工程师学会(IEEE)的1364号标
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VerilogLRM.Verilog-AMSLanguageReferenceManual.Version2.4.0May30,2014
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verilog分频,能计数到12个bit, 每1s钟计数一次。设计的很巧妙