基于FPGA的数字下变频算法设计

数字下变频(DDC)技术是软件无线电接收机的核心技术。其基本功能是从输人的宽带高速数字信号中提取所需的窄带信号,将其下变频为数字基带信号,并转换成较低的数据率,以供后续的DSP作进一步的处理。

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：在Q-砒．sⅡ开发环境下，用Verilog HDL硬件描述语言设计了一个可以在FPGA芯片上实现的数字 时钟．通过将设计代码下载到FPGA的开发平台Ahera DE2开发板上进行了功能验证．由于数字

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在动目标速度测量的工程应用背景下，针对传统频谱细化技术计算量大和实现困难的缺点，提出一种数字变频FFT的频谱细化算法，并根据其数学原理，进行了基于LabVIEW的两种编程设计方法研究。仿真结果表明，两

软件无线电设计实例1：数字上下变频器，希望对大家有用

基于软件无线电的数字下变频实现方案研究，吴杰，，数字变频是软件无线电体系中的关键技术之一，本文就数字下变频的体系结构进行了阐述，然后主要讨论了基于FPGA的数字下变频实现方��

S频段2.2~2.3GHZ变频到70MHz,方案设计。包含变频器的器件选型,方案设计,指标预算,频率源的方案设计,相位噪声预算等。

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本人认为的一篇很好的论文，对于数字下变频的讲解很详细，各项技术指标给的很明确，相信对于想学习DDC的同学会有帮助。