FPGA源代码
一个时钟分配电路,输入为时钟信号CLK,输出为信号F0~F5,这六个信号中只允许有一个为高电平,F0、F2、F4的持续时间为2个CLK,F1、F3、F5的持续时间为4个CLK。
用户评论
推荐下载
-
fpga的SDRAM代码
FPGA的SDRAM代码。很好的学习资料。
25 2020-01-28 -
FPGA的SPI代码
FPGA的SPI代码、VHDL、支持主SPI和从SPI两种模式
27 2020-05-13 -
FPGA的VHDL代码
这是一些非常实用的代码, 适合初学者学习
19 2020-11-24 -
FPGA vga显示代码
verilog实现VGA显示的代码,包括驱动,时钟管理,显示的全部,代码中包括三个实例,一个最常见的八个彩带型,一个矩形框,一个魔幻彩带显示实现
25 2020-02-19 -
FPGA的alu代码
alu的代码程序,是包含加减乘除以及或的用算
26 2019-01-15 -
fpga例程与代码
对学习很有用,尤其是初学者,希望大家多多下载
18 2019-01-20 -
FPGA的Verilog代码
FPGA VEILOG代码 非常实用 很有用 大量
31 2019-03-10 -
FPGA IIC通信代码
零基础学FPGA(十一)初入江湖之IIC通信代码 对于新手来说是非常不错的学习资料
33 2019-04-02 -
DDS代码基于FPGA
基于FPGA的DDS信号发射器,里面有详细方案设计,采用ROM存储
23 2019-07-28 -
正点原子FPGA代码
正点原子FPGA代码
162 2019-06-05
暂无评论