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一个用verilog编写的DDS,基本上是模仿ad9850芯片编写的。其中DA芯片用的是AD9767,fpga用的是xilinxspartan6的,最高工作时钟为125MHz,该频率下最高可产生10M
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基于Verilog的IIC分析+代码
这是FPGA的基础教程。基于verilog HDL语言,通过具体的实例来学习FPGA。
FPGA实现DSP的Verilog示例,很不错哦,值得学习的
基于verilog的FPGA设计基础.pdf
支持一小时正数倒数计时,具有蜂鸣器秒响功能,暂停开始功能等
FPGA课程:有关FPGA Verilog代码的课程
个人课程作业,基于VerilogHDL的数字时钟设计,包括源代码和设计报告,供交流学习使用。如有使用,请注明出处。
