推荐下载
-
PCB技术中的高速PCB布线差分对走线
为了避免不理想返回路径的影响,可以采用差分对走线。为了获得较好的信号完整性,可以选用差分对来对高速信号进行走线,如图1所示,LVDS电平的传输就采用差分传输线的方式。 图1 差分对走线实例 差
11 2020-11-17 -
Altium_Designer_PCB中差分线的设置与布线
Altium_Designer_PCB中差分线的设置与布线,PDF文档,欢迎下载
13 2020-07-22 -
DXP的等长布线图解说明
DXP 的等长布线图解说明,内含详细解释说明
12 2018-12-20 -
画DXP封装方法
画DXP封装:搜集了一些自己画封闭的方法和技巧。
22 2019-07-22 -
高速差分信号线选择指南共模扼流线圈选择要点
测量高速差分信号线噪音,保持良好的信号质量十分重要,文章就为大家介绍一下高速差分信号线选择指南——共模扼流线圈选择要点。
12 2020-07-24 -
一种4Gb s低压差分信号比较器的低抖动优化设计
基于低压差分信号比较器的结构,研究了影响比较器输出抖动的各种因素,并指出:根据差分信号的输入摆幅来优化电路有助于降低电路的输出抖动。基于0.13μm CMOS工艺,优化设计了一种低抖动的
2 2021-04-21 -
基于间接平差中的粗差探测方法
间接平差误差方程式中观测值与近似值之差l包含观测值L的信息,如L中含有粗差必在l中反映出来。文中推导出l具有数学期望为小于三倍中误差的常数和方差等于观测的方差这两条重要特性,可以区分出含有粗差的l和不
14 2020-07-17 -
在布线过程中布线工程师如何充分掌控时钟信号
当电路从前工序设计人员转移到后工序布线工程师时,可以认为时钟概述与图表是必须沟通的最关键信息。多年以来,由于沟通失误,数以小时、天甚至是星期计的设计工作沦为白费,需要包括时钟树在内的全套重新合成
6 2020-10-04 -
混合信号PCB设计的布局和布线方法解析
模拟电路的工作依赖连续变化的电流和电压。数字电路的工作依赖在接收端根据预先定义的电压电平或门限对高电平或低电平的检测,它相当于判断逻辑状态的“真”或“假”。在数字电路的高电平和低电平之间,存在“灰色”
5 2021-02-23 -
PCB技术中的如何利用Protel DXP手工修改电路板布线
1.PROTEL的DXP手动修改转接线太多线PROTEL的DXP自动布线的原因,因为算法,通常接线的角落太多,这往往使陷入困境的观点看,经过手工调整,这种现象可大大改善。这项调整将涉及相互关系的电线,
16 2020-11-08
用户评论