VHDL的例代码，例如二选一，半加器

VHDL设计简单例程100例,简单入门VHDL语言100例 第1例 带控制端口的加法器 第2例 无控制端口的加法器 第3例 乘法器 第4例 比较器 第5例 二路选择器 第6例 寄存器 第7例 移位寄存

VHDL语言100例详解很经典的例子，且具体剖析，非常实用

此文件为VHDL100例语言学习教材，由北京理工大学ASIC研究所根据多年教学经验编写，内容基础详实，适合初学者学习参考。

本材料详细的描述了VHDL的设计流程和详细的实例分析，对于FPGA的设计都有具体的例子来补充，对初学者大有裨益。

非常好的VHDL实例，很不错，有源码程序。

VHDL语言的100个例子，希望对学习VHDL的人有帮助。

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基于VHDL的DDS函数发生器代码，还有AD9850的全套资料，要的q我

opencore上的6502微控制器CPU的VHDL代码，内附详细说明。