和基于ASIC（专用集成电路）的时钟电路相比，基于FPGA（现场可编程门阵列）的时钟电路有其自身的特点。FPGA一般提供其专用时钟资源搭建时钟电路，相应的综合工具也能够自动使用这些资源，但是针对于门控时钟和时钟分频电路，如果直接使用综合工具自动处理的结果，会造成较大的时钟偏差。通过合理使用DCM（数字时钟管理单元）和BUFGMUX（全局时钟选择缓冲器）等FPGA的特殊资源，手动搭建时钟电路，可以尽可能地减少时钟偏差对电路时序的影响。