FPGA的TLC5615驱动程序用VHDL语言实现
使用VHDL语言实现的TLC5615的驱动程序
已经在FPGA(AlteraEP4CE6E22C8N)上验证通过
时钟频率为50MHz经过6分频后得到8MHz最终的时钟频率请参看TLC5615_TransmitData.vhd中描述
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