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串口通信代码及仿真verilog
基本介绍见博主博客,包含详细的仿真及代码。平台为ISE,方便移植到quartus
22 2019-09-29 -
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43 2019-01-18 -
串口通讯设计之Verilog实现
串口通讯设计之Verilog实现:FPGA串口模块是将由RS-485发送过来的数据进行处理,提取出8位有效数据,并按异步串口通讯的格式要求输出到MAX3223的12脚。
30 2019-04-12 -
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基于verilog的串口通信协议,包括工程文件及仿真文件。
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8 2020-08-15 -
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8 2020-07-27 -
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