Powerbuilder学习教程,很实用的,尤其是它的数据窗口技术很好!
这本书在我们这里总是找不到完整版的,那个分两部分的还少了两章,所以,我从网上找到了完整的合并后发到这里。
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在Verilog HDL中,描述组合逻辑时常用的assign结构。 Equal=(a= =b)?1:0,这是一种在组合逻辑实现分支判断时常用的格式。 测试模块用于检测模块设计是否正确。它给出模块的输入
OpenGL初级教程 非常实用 很详细 作者语录: 我不是一个天才的程序员,我只是一个普通的编程者,每一天都在学习OpenGL。我不宣称我了解OpenGL的每一个方面,也不保证我的代码没有bug,但我
protel教程 自己搜集的 个人觉得还是有用的 不知道你们能不能用得着
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如果你作过一段时间的专业Web设计者,你很可能用过所见即所得的编辑器。或许重复不断地用手工插入黑体tag使你的大脑麻木,或许你认为应该有一个更好的方式管理一个50列的表格。或者,最糟糕的是,有些大人物
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