基于quartus II 设计的全加器VHDL,逻辑图以及VWF
基于quartus II实现的全加器 内含实现全加器的VHDL代码、逻辑图(BDF)以及激励波形文件(VWF)。
文件列表
基于quartus II 设计的全加器VHDL,逻辑图以及VWF
(预估有个101文件)
FA.fnsim.cdb
773B
FA_global_asgn_op.abo
14KB
FA.rtlv_sg_swap.cdb
192B
FA.sgdiff.cdb
782B
FA.rtlv_sg.cdb
750B
FA.sim.cvwf
1022B
FA.map.bpm
471B
FA.pre_map.cdb
834B
FA.cmp.bpm
483B
FA.map_bb.cdb
619B
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