电压调节技术用于SoC低功耗设计

导读:随着亚微米、深亚微米技术和系统芯片(SOC)技术的日益成熟,功耗已经成为模拟电路设计中首要考虑的问题,低电压低功耗集成电路设计渐渐成为主流。 因为MOS晶体管的衬底或者与源极相连,或者连接到

本文针对集成电路低功耗进行了全面的分析,通过对功率损耗的产生以及功率损耗对集成电路的危害,提出了集成电路功率损耗的估算方式,并且给出了估算的公式,可以通过最快的速度对集成电路功耗进行估算。

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在电源设计中,可以手动设置所需的输出电压。在大多数集成电源电路以及开关和线性稳压器IC中,这可以通过分压器来实现。为了能够设置所需的输出电压,两个电阻的阻值比必须合适。 图1所示为一个分压器。 “

设计了一种低功耗的多电源多地电压多米诺电路。该电路在多电源电压技术的基础上,通过提高地电压并采用共阱工艺降低功耗及优化面积。该设计采用Charter 0.35 ?滋m 2P4M N阱CMOS标准工艺完

文章提出一种基于耗尽型晶体管与增强型晶体管串联产生基准电源的无运算放大器结构电路。通过将两个基准电源电路级联,可以获得较好的电源抑制比特性,并保持较小的电压功耗。TT模型下的仿真结果表明,基准电源的电

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随着全球能源危机的凸显,世界对能源的关注达到了前所未有的程度,各种政策纷纷出台。目光也从传统的工业制造领域延伸道了消费电子市场。美国的能源之星计划进一步激活了对电源功耗问题的关注。消费者对电子产品要求

本文采用自顶而目的设计原则,从体系结构到电路实现上分层次探讨了时钟芯片的功耗来源,并采取相应的控制手段实现芯片的低功耗设计。

为了减少芯片功耗,可靠的低功耗物理设计必不可少。基于新一代布局布线工具Innovus,分四个部分阐述了新的低功耗物理设计流程。这些内容包括:基于低功耗的物理库设计;低功耗布局和优化、基于输入向量的功耗