可配置逻辑块由4个相互连接的Slice和附加逻辑构成,用于实现组合逻辑和时序逻辑。其拓扑结构如图1所示,每一对Slice分布在同一列并共有一条独立的进位链。 图1 CLB拓扑结构 用于组成同一个CLB的4个Slice共用以下两个函数发生器、两个存储单元、多层函数复用器、进位逻辑和算术逻辑,如图2所示。左侧的Slice通常用SliceM表示;右侧的Slice对通常用SliceL表示,它们通过这些单元实现逻辑、算术和ROM的功能。除此之外,SliceM还可以用做两种特殊的功能,即分布式RAM和16bit移位寄存器,分别用于数据存储和数据移位操作。同时通过这个简图可以清楚了解除了Sl