二 十进制译码器74LS42实验电路multisim源文件

vhdl实验二（异步触发十进制加法计数器），有源程序，仿真图，eda2000连接图。

二位十进制计数器实验报告

用74LS90实现十进制计数器的设计与显示数电课设做的

0174LS138译码器应用,即关于138芯片的各个管脚来控制使能端的电平，

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