EDA/PLD中的基于FPGA的SDRAM控制器设计

1 引 言 SDRAM的特点是大容量和高速度。其单片容量可达256Mb或更高,工作速度可达100~200MHz以上,但是其控制方式比EDO/FP DRAM复杂得多。目前,许多嵌入式设备的大容量存储器都采用SDRAM来实现。在设计中采用SDRAM存储器时,大多都是用专用芯片完成其控制电路。但是,当我们对SDRAM存储器进行特殊应用时,就需要自己设计控制电路了。 我们知道,显示器在显示文字或图形时,显示器在帧频、行频、彩色视频信号的控制下,控制电子束顺序地从上到下,从左到右逐行扫描。而这些显示控制信号是由显示控制器产生。在雷达光栅显示系统中,显示帧缓冲存储器(VRAM)存储雷达的实时信号。而