EDA/PLD中的FPGA在便携式产品中应用的低功耗实现方法
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摘 要:本文提出了一个AES加密算法的高速低功耗ASIC设计方案,使用Synopsys设计流程和VeriSilicon 0.18μm CMOS工艺,实现了最高工作频率410MHz,数据吞吐率5.23G
10 2020-12-03 -
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6 2020-12-03 -
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27 2020-12-13
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