万能时钟发生器板的设计
本文描述了一个精密时钟发生器电路板的设计,该设计可在一些电信或数据通信专门实验室测试工作中用作波形发生器。该时钟发生器输出一组固定频率的时钟,使用一个外部同步时钟参考作为输入。 设计的核心是U1,即ZL30407光同步网络/同步数字系列(Sonet/SDH)网络元件PLL(见图1)。ZL30407将产生一组同步到20MHz输入主时钟的SONET和PDH时钟。当与Stratum 3或更高质量的主时钟耦合时,其输出将满足Stratum 3E漂移精度要求。 ZL30407可通过DIP开关配置为运行于硬件模式,还可以对该器件输出时钟小频率偏移进行编程。为此,器件必须工作在软件模式。软件模式操作需要使用
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