SystemVerilog:英特尔ModelSIM 源码
SystemVerilog 英特尔ModelSIM
文件列表
SystemVerilog-main.zip
(预估有个9文件)
SystemVerilog-main
README.md
31B
TestBench
tb_basic_logic_circuit.sv
737B
Readme.md
2B
tb_delayed_logic_circuit.sv
948B
image.jpeg
51KB
Projects
basic_logic_circuit.sv
185B
delayed_logic_circuit.sv
271B
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