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基于FPGA的六层楼电梯控制器VHDL源代码。
Altera官网提供的SDR_SDRAM控制器的verilog和VHDL源程序，以及相应的仿真代码，还有一些说明文件，可直接调用，有利于SDRAM的学习。
电流互感器作为高压电网检测主要设备,不仅为电能的计量提供参数,而且是为继电保护提供动作的依据。随着国家智能电网和特高压电网的发展,传统电磁式电流互感器逐渐暴露出其致命缺陷,例如高电压等级时绝缘极为困难
作者Email: huangtao2008@126.com 摘要:本文讲述了光源的两种变换效果控制电路的设计,即光源的跳边和渐变。这两种控制电路的设计思想都是,通过555电路产生计数脉冲送入12位二进
在高速实时或者非实时信号处理系统当中,使用大容量存储器实现数据缓存是一个必不可少的环节,也是系统实现中的重点和难点之一。SDRAM(同步动态随机访问存储器)具有价格低廉、密度高、数据读写速度快的优点,
通过一个简单的例子介绍了VHDL语言的应用,对比地给出了功能仿真和时序仿真的波形,说明了实现电子电路的自动化设计(EDA)过程。
实验内容1、使用VerilogHDL设计一个VGA显示控制器，在VGA显示器（VGA：分辨率：640x480@60Hz）上显示RGB八色彩条。2、VGA显示器（分辨率自定）上显示杭电logo+学号姓名
《VHDL电路设计》一书的案例源程序，用于学习VHDL语言
这是一个有VHDL写的时钟程序他的功能包括整点报时条表扫描显示等等
自同期并网是在待并网发电机组未加励磁的情况下,当确认待并网发电机组的相序与已运行发电机组的相序一致时,将待并网发电机组启动到接近同步转速,立即合闸并网,并迅速加上励磁,使待并网发电机组自动地拖人同步,
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