全志T3开发板参考设计_包含:核心板底板LCD板.zip

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全志T3开发板参考设计_包含:核心板,底板,LCD板.zip

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全志T3开发板参考设计_包含：核心板，底板，LCD板

开发板硬件

核芯板

SCH

T3_MAIN_DDR3_16X2_V1_0_20160605.DSN 1.62MB

t3_main_ddr3_16x2_v1_0_20160605.pdf 514KB

t3_main_ddr3_16x2_v1_0_20160605.opj 4KB

t3_main_v1_0_20160218.opj 4KB

T3_MAIN_DDR3_16X2_V1_0_20160605_0.DBK 1.62MB

T3_MAIN_V1_0_20160218_0.DBK 1.6MB

pcb

T3_MAIN_PCB20160224_V1.0.tgz 4.36MB

T3_MAIN_PCB20160224_V1.0.eco 223B

T3_MAIN_PCB20160224_V1.0.pcb 3.73MB

LCD板

SCH

t3-lcd.opj 1KB

T3-LCD.DSN 435KB

PCB

T3_LCD_PCB20160314_V1.0.pcb 2.35MB

底板

SCH

T3_DBOARD_V1_0_20160303.ONL 644KB

t3_dboard_ddr3_16x2_v1_0_20160303.opj 3KB

T3_DBOARD_V1_0_20160303.asc 108KB

T3_DBOARD_V1_0_20160303_0.DBK 3.36MB

t3_dboard_v1_0_20160303.opj 9KB

t3_dboard_v1_0_20160303.pdf 1.45MB

T3_DBOARD_V1_0_20160303.DSN 3.36MB

T3_DBOARD_V1_0_20160303.DRC 333B

PCB

signoise.run

cases.cfg 80B

cases.cfg,1 56B

case1

allegro.jrl,1 819B

batch_drc.log 1KB

T3_MAIN_PCB20160224_V10.brd 4.71MB

master.tag 29B

allegro.jrl 32KB

T3_MAIN_PCB20160322_V1.0.pcb 10.84MB

T3_MAIN_PCB20160322_V1.0.eco 105B

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