VHDL结构级描述的译码器设计

a56417 22 0 RAR 2019-01-09 02:01:09

标准的2-4线译码器VHDL语言结构级描述设计，这个设计包含的工程文件通过ISE编译综合，经过仿真证明准确无误。

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卡了网匿名网友 2019-01-09 02:01:09

还行，挺实用的