理解DDR3测试参数的详细解释

DDR3最新规范JESD79-3C，又需要的朋友可以看一下。

DDR2已渐渐淡出业界，DDR3风头正茂。该文档是最新的DDR3标准，是最详细最基础的介绍DDR3的资料，值得每一个硬件工程师拥有。

作为电子与通信工程及其相关的资料。对于那些从事软硬件开发、集成电路设计、系统设计的工程技术人员来说也是一本很好的文章。 它主要涉及到对DDR2和DDR3在设计印制线路板(PCB)时,考虑信号完整性

4Gddr3数据手册。西安紫光，国产DDR3。资源很好。欢迎下载.含有描述器件布局结构。读取时序。命令码，真值表等信息。

高速先生前面零零散散的写了一些DDR3系列的文章,虽然有小部分的案例说到了问题点,但那只是为了引出主题而写,而且只是点到为止,既然是案例,就要把问题的来龙去脉描述清楚,这个案例的问题是这样的。

DDR3的设计有着严格等长要求，归结起来分为两类（以64位的DDR3为例）：数据（DQ,DQS,DQM）：组内等长，误差控制在20MIL以内，组间不需要考虑等长；地址、控制、时钟信号：地址、控制信号以

DDR3绕线规则,都是干货，比较实在的等长规则，分享给大家。

这是DDR3内存条详细的pdf原理图资料，是UDIMM（无缓冲双通道内存模块），240个引脚。

ddr3的参考设计，pcb是allegro格式（.dra)

图文并茂、简明易懂的MIG仿真、综合、自定义用户接口教程，适合FPGADDR3初学者