本篇文章介绍一种基于CPLD芯片的数字时钟设计VHDL代码，并对其操作做出详细说明。该数字时钟能够实现以时间24小时为一个周期的计时和显示，还拓展了闹钟模块和秒表模块。另外，该设计具有校时功能和报时功能，方便用户使用。具体可通过Quartus II编程软件实现编程。我们希望本篇文章能够帮助读者更好的理解数字时钟的原理及制作方法。
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VHDL 编写的既有：时分可调、整点报时功能的数字时钟。运行于quartus_ii_8.0软件
有关VHDL的电子时钟的程序的课程设计，分步讲解，比较的详细。
硬件描述语言的最终课程设计，可以在电路板上实现时钟的一系列功能
用硬件描述语言设计的电子时钟，硬件描述语言。。。现代逻辑器件
基于VHDL语言实现时钟的基本功能,具有定点报时等基本功能。
VHDL 数字控制系统设计范代码 设计 , 数字控制 VHDL 数字控制系统设计范代码.rar
复杂数字系统是现代电子系统最重要的组成部分,培养学生掌握九十年代后期先进的设计技术关系到我国电子和信息工业的发展。复杂数字系统的硬件描述语言建模、仿真和综合技术是设计高性能数字信号处理电路的关键技术。
VHDL数字系统设计（课件），很好的vhdl基础课程课件！
基于VHDL的数字闹钟设计 随着EDA技术的发展和应用领域的扩大与深入EDA技术在电子信息、通信、自动 控制及计算机应用领域的重要性日益突出。EDA技术就是以计算机为工具设计者在EDA 软件平台上
eda ,vhdl, 包括去抖电路，及闹钟功能
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