# Verilog仿真结果分析

关于verilog仿真使用#和的仿真结果不同的研究

最近仿真一段很奇怪的代码,testbench中分别使用#和@,但是输出波形不一致。
10 PDF 2020-08-30

RFID系统仿真结果分析

仿真中使高斯白噪声信道的信号噪声比从0dB到14dB变化,记录每一个信噪比值对应的误码率,仿真结果如图所示...
9 PDF 2020-10-28

常见的乘法器Verilog源代码及仿真结果

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模糊PID的simulink仿真结果分析

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49 DOC 2019-05-14

通信信道Simulink仿真20110526实验结果分析

包含加性高斯白噪声信道、瑞利信道、莱斯信道、二进制平衡信道的simulink建模仿真
30 PDF 2019-07-22

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24 PPT 2019-05-27

串并转换的实现方法和仿真结果Verilog代码和Testbench示例

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15 rar 2023-09-01

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eMMC仿真模型Verilog

用于FPGA开发eMMC存储芯片的仿真模型,事半功倍,代码是Veriog语言的
435 RAR 2019-03-15