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摘要 : 差 错 控 制 是 数 据 通 信 中 常 用 的 传 输 错 误 检 测 措 施 。 接 收 端 通 过 对 接 收 到 的 数 据 进 行 循 环 冗 余 校 验 (CRC), 就 可 以 检 测出 数 据 包 在 传 输 过 程 中 是 否 发 生 损 坏 。本 文 详 细 介 绍

本设计是利用VHDL硬件描述语言设计CRC发生器和校验器。12位信息加5位CRC校验码发送、接收,由两个模块组成,CRC校验生成模块(发送)和CRC校验检错模块(接收),采用输入,输出都为并行的CRC校验生成方式。产生此CRC码可利用Peterson和Brown提出的移位寄存器电路实现。初始时置各寄