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北京市大学生集成电路设计大赛题,纯个人练习,使用Verilog HDL编写,内部模块包括M序列发生器、串并转换、ASK调制、波形发生器(峰值为64的正弦波与余弦波)、加法器,因此程序为个人练习,所以代码无注释,但有设计报告对模块有具体说明,有需要的同学可以下载参考

自己练手的小游戏,使用QT开发,C++语言编写,一个规则类似北京浮生记的小游戏,内有原工程文件,需要的同学自行下载