fifo 手册

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基于FPGA的高速异步FIFO设计

数字信号处理中经常使用到FIFO存储器，本程序就是用verilog语言编写的FIFO存储器，将每个模块分开，层次清晰。

模拟FIFO调度算法包含整个实验报告

slave FIFO verilog code

异步_fifo 这是异步fifo的初始文件; 这用于读写具有独立时钟的FIFO,以减轻ASIC设计中的CDC问题。 指针使用格雷码同步器进行同步。 0.0.1-初始文件-仅对RTL进行编码,尚未模拟

暂无介绍

这是自己在os课实验上自己写的一个页面替换算法cpp文件，里面包含了FIFO与LRU置换算法的实现程序。简单正确，同时加上了代码注释，一目了然。

利用fifo传递函数指针，调用函数。测试demo。用与缩减线程数量，使用fifo管理线程使用。

使用verilog语言实现异步FIFO。并且在modisim仿真成功。并且附带(_tb)文件,可以直接运行。