基于quartusII的VHDL数字钟设计

FPGA的一篇论文。。方便大家学习和上交毕业论文，期末论文

数字逻辑课程设计VHDL多功能数字钟这个数字钟是我根据我老师的设计自己改编的，内部结构变化挺大的，功能也比较全。1、具有以二十四小时制计时、显示、整点报时、时间设置和闹钟的功能。2、设计精度要求为1秒

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真金不怕火炼,只有运行出来了的作品才敢往上面传,希望能帮到大家

这是由maxplu设计的一个基本数字钟，可以实现基本的计时功能！

要求显示秒、分、时 可清零、可调时。

数字钟的设计论文

很好的基于NiosII CPU的设计范例，数字钟在设计中也十分实用。

数字钟的基本功能，verilog语言实现。

EDA数字钟实现，硬件编程，可编程逻辑器件