基于FPGA的AES算法实现

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aes128位数据加解密算法源码，有veriolg硬件描述语言写的

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基于FPGA的AES算法实现 (预估有个132文件)

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aes_key_expand_128.v 1KB

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aes_cipher.sta.summary 2KB

lpm_rom0_syn.v 20KB

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lpm_rom1.bsf 3KB

aes_sbox0.vwf 9KB

aes_sbox.v 5KB

aes_cipher.flow.rpt 8KB

aes_cipher_top.bsf 3KB

readme.txt 8KB

aes_cipher.hex 4KB

aes_sbox0.v.bak 9KB

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