CPU自制入门HDL代码

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UART Verilog HDL代码,经过RTL仿真和FPGA验证。 波特率支持9600~921600等8种,并支持灵活可配。

hdl-hdl_2015_r2，ADI公司出品用于配置AD9361的verlog代码集

HDL参考设计 HDL库和项目,用于各种参考设计和原型系统。 该存储库包含HDL代码(Verilog或VHDL)和使用Xilinx和/或Intel工具链创建和构建特定FPGA示例设计所需的Tcl脚本。

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自制解数独问题源代码输入9*9的二维数组，空位以零代替输出所有可能的解

自制安装程序delphi源代码。也是从别的地方下的，给有用的人

《自制编程语言》高清PDF文档+全书代码文件，适合学习用。