FPGA数字信号处理(六)直接型IIR滤波器Verilog设计

Vino_lai 31 0 7Z 2020-05-24 13:05:54

使用Vivado完成直接型结构IIR滤波器VerilogHDL设计，含testbench与仿真，仿真结果优秀；具体说明可参考本人博客。CSDN博客搜索：FPGADesigner

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N=15,33 N=15; wc=pi/4; a=(N-1)/2; n=0:(N-1); m=n-a+eps; hdn=sin(wc*m)./(pi*m); wn=hanning(N); hn=hdn

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用户评论

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卡了网匿名网友 2020-05-24 13:05:54

正在使用IIR来做处理，下来看看

卡了网匿名网友 2020-05-24 13:05:54

拿来试了试，可以玩一下

卡了网匿名网友 2020-05-24 13:05:54

版本无所谓的，自己弄一下就行了

卡了网匿名网友 2020-05-24 13:05:54

有没有quartsII版的