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altera-fpga设计实例源码分析，数字图像分析应用
非常详细的FPGA内核资料，便于学习理解altera公司的FPGA
AlteraFPGA工程师成长手册
AlteraFPGA_CPLD设计(高级篇)后续还有初级篇，等会上传
在实际工程应用中，我们时常会遇到为解决某个老产品的BUG，需要在工程现场更新设备的FPGA代码，或者参加电信测试时需要现场升级设备FPGA程序以便于调试。公司现阶段所用的AlteraFPGA程序代码一
altera官方FPGA设计宝典，详细系统介绍了alteraFPGA的使用和设计的各方面。
ALTERA FPGA／CPLD设计 高级篇配套CD
使用verilog HDL语言编写的串口IP核，经过波形仿真验证
在altera CycloneII的EP2C8的FPGA下 基于IP核的FIR滤波器设计，该设计为低通滤波器，截止频率为50KHz
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