基于FPGA的任意字节数的UART串口接收工程源码
基于Intel Altera的Quartus II平台FPGA的任意字节数的UART串口接收工程源码1详细的仿真TB文件2单字节起始位1bit数据位8bit停止位1bit无奇偶校验3通过参数化设置可实现任意字节数的UART接收4详细的说明文件请参考本人博文https wuzhikai.blog.csdn.Net article details126229191.
文件列表
基于FPGA的任意字节数的UART（串口）接收工程源码
(预估有个779文件)
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uart_bytes_rx_run_msim_rtl_verilog.do.bak
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5KB
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