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CY7C68013读写FIFO源代码Verilog

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llIIIlIIllIIl 46 0 V 2019-01-10 11:01:50

CY7C68013读写FIFO源代码（Verilog）.

用户评论
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评分：
Generic placeholder image 卡了网匿名网友 2019-01-10 11:01:50

Verilog HDL 编写的CY7C68013 slave fifo接口程序，实际测试可用。可以直接跟上位机连接，传输数据。感谢

Generic placeholder image 卡了网匿名网友 2019-01-10 11:01:50

非常好，读写一起！！不像别的只有读或是只有写。

Generic placeholder image 卡了网匿名网友 2019-01-10 11:01:50

加上自己的心得体会描述就更完美了

Generic placeholder image 卡了网匿名网友 2019-01-10 11:01:50

是基于CY7C68013的好东西！