VerilogHDL系统任务及TestBench编程方法

一本比较好的FPGAtestbench编写英文书籍，对于初学者可以学习。英文资料相对中文资料讲的通俗易懂。

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Testbench entry information - testbench preliminary

编写testbench非常实用的总结，包括激励设置，仿真设置等。另外还有一些实用的编写testbench的技巧！

简单的uartverilog源码，没有奇偶校验位，1bit停止位，8bit数据位，MSB先。实际测试通过。可在此基础上修改自己需要的uart源码

VerilogTestbench从零开始编写

目前最经典的IC验证相关的systemverilog书籍，没有之一

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