NOR & NAND & DRAM & SRAM & SDRAM

NorFlash学习笔记NorFlash型号:AM29LV160DBCPU:S3C2440A(ARM9)

This standard was prepared by the JEDEC SFDP Task Group authorize by the JC-42.4

项目Nor项目之家（非Tor项目） Nor项目致力于创建一个轻量级但兼容的Tor分支，它是Tor项目集中式目录授权服务的替代方案。该项目旨在插入现有的Tor生态系统并补充和加强Tor，而不是取代它。为

一般地,DRAM控制器内部都设计成在一定周期内要请求DRAM刷新操作,协调该请求与来自主机(一般为CPU)的访问,然后进行DRAM刷新操作或者存取操作。简单的如图1所示。 图1 DRAM控制器的内

DRAM从最初时期的产品至今所利用的信号类型如图所示。DRAM的主导产品已经逐步移向与时钟同步的同步DRAM及Direct Rambus DRAM(直接总线式DRAM),所以我们所说明的这种类型的DR

在快速翻页模式中,如果CAS无效,则将停止DQn的驱动,数据将随之消减。取代这种方法,而采用即使CAS无效,也能保持数据输出的方法,即采用EDO(Expansion Data Output,扩展数据输

这是为适应低功耗等需求而设计的模式。由于DRAM的刷新电路一般都设计在外部,因而即使在待机状态下,为了进行刷新操作也需要运行DRAM控制器电路。 对此,在DRAM内部嵌人刷新计时器以及刷新地址生成

同步DRAM的信号类型如图1所示,其中存在时钟(CLK)、时钟使能(CKE)以及存储块(Bank)编号指定等若干信号的更改,但可以看出,同步DRAM沿用了异步DRAM的信号。SDRAM将内部分割为若干

DRAM基本的存取操作如图所示,结合RAS及OAS的有效,分割为行地址和列地址赋予地址。进行读操作时,如果在这里DE有效,则DQn引脚被驱动,读出数据。另一方面,进行写操作时,在CAS有效之前WE有效

DRAM单元的基本结构如图所示,负责数据存储的是图中的电容器,根据是否存储电荷来判断数据的“0”、“1”。图中电容器的一端接地,因为是交流接地,所以不是形成GND电平的意思。电容器的另—端与用于存取开