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基于FPGA的卷积码Viterbi译码器性能研究
卷积码是一种前向纠错控制(ForwardErrorControl,FEC)编码方式,其特点是接收端根据接收码字自动检测和纠正信道传输引入的错误。由于FEC方式不需要反馈信道,译码实时性比较好,控
7 2020-10-19 -
水声OFDM系统中卷积码译码设计及其DSP实现
纠错编码是水声OFDM通信系统必须采用的关键技术。本文从译码性能和工程实现角度出发,采用卷积交织、卷积编码和Viterbi软译码相结合的差错控制方案,通过仿真和水池实验确定其参数,并在TMS320DM
5 2020-10-27 -
基于VHDL语言的卷积码和Viterbi译码的实现
介绍并用VHDL语言实现了卷积编码和维特比译码。根据编码器特征设计了一种具有针对性的简洁的维特比译码器结构,并通过ModelSim平台验证了该设计的正确性。
21 2020-10-27 -
基于FPGA的卷积码的编译码器设计
为了解决传统的维特比译码器结构复杂、译码速度慢、消耗资源大的问题,提出一种新型的适用于FPGA特点,路径存储与译码输出并行工作,同步存储路径矢量和状态矢量的译码器设计方案。该设计方案通过在ISE9.2
11 2020-10-27 -
卷积码维特比译码算法最佳反馈深度研究.pdf
这是一篇中文期刊数据库中的文章,在网上找到了它的名字,在学校的期刊中找到了它,和大家共享一下
11 2020-09-20 -
卷积码发生器的设计维特比Viterbi译码
本课程设计主要解决对一个卷积码序列进行维特比(Viterbi)译码输出,并通过Matlab软件进行设计与仿真,并进行误码率分析。根据线性幅度调制原理,设计一个AM调制系统,实现模拟混合加性噪声的情况下
17 2020-07-18 -
卷积码2_1_3编译码课程设计
卷积码(2_1_3)编译器的设计,卷积码原理、发展,卷积码编码过程和维特比译码。
54 2018-12-29 -
吉比特里所码和卷积码级联译码器设计
针对60-GHz无线个域网,提出了一种吉比特里所码和卷积码级联译码器架构。在推荐级联架构中,里所码和卷积码分别作为外码和内码,通过交织器级联。采用基于Viterbi算法的8路并行卷积译码结构和基于Ri
11 2020-10-28 -
差错控制编码课件差错控制卷积码分组码
差错控制编码的基本做法是:在发送端被传输的信息序列上附加上一些监督码元,这些多余的码元与信息码元之间,以某种确定的规则相关联(相约束)接收端按照既定的规则,检验信息码元与监督码元之间的关系。一但传输过
13 2020-08-18 -
基础电子中的卷积码编码和维特比译码性能的对比分析
摘要:本文对比了在加性高斯白噪声(AWGN)信道下经BPSK调制后的数据不编码与添加卷积编码后接收到的信道输出的误码性能,并通过对比对卷积码性能进行分析。采用MATLAB自编函数对卷积码以及维特比译码
10 2020-10-27
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