在MAX+PLUS II中采用LPM图元设计一个4 16译码器采用基本门电路设计一个一位的全加器
1.在图形编辑器中采用LPM图元设计一个4-16译码器,以decoder16.gdf命名保存。将器件设定为EPM7128LC84-6。输入D、C、B、A绑定到10,11,12,13管脚,输出Y0....Y15按顺序绑定到60至75管脚。进行波形仿真,验证功能正确。分析节点A到节点y15的最短延时。 2.在图形编辑器中,采用基本门电路设计一个一位的全加器,以FADDER.gdf命名保存。器件设定为EPM7128LC84-6。输入Ain、Bin、Cin(进位输入)分别绑定到Pin21、22、23,输出So、Co分别绑定到Pin41、42。进行波形仿真验证其功能正确。分析输入节点到输出节点的最短时间。
文件列表
shiyan1.rar
(预估有个28文件)
shiyan1
fadder.gdf
2KB
fadder.acf
16KB
decoder16.snf
12KB
decoder16.cnf
7KB
decoder16.rpt
21KB
fadder.jam
34KB
decoder16.ndb
2KB
fadder.hif
2KB
fadder.pof
8KB
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